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PIE
  • 對于標簽芯片，降低系統(tǒng)時鐘頻率是降低功耗、提高通訊距離的最有效手段。首先從理論上按照一種等效判決方法推導出PIE解碼電路的更低時鐘頻率，提出了一種低時鐘頻率下基于ISO 18000-6 TYPE C協(xié)議的UHF RFID標簽芯片解碼電路的實現(xiàn)方案。設計的解碼電路大幅度降低了標簽芯片解碼電路功耗，提高了標簽響應靈敏度。
  • 根據(jù)超高頻RFID國際標準協(xié)議EPC GEN2中的規(guī)定，基于ARM9芯片S3C2440提出一種適用于超高頻讀寫器的PIE編碼以及MILLER2解碼的實現(xiàn)方式。設計中使用該芯片的PWM輸出進行編碼，并使用其外部中斷進行解碼。通過分析示波器捕捉到的MILLER2波形以及串口打印的解碼輸出，驗證了該設計的正確性。
  • 本文介紹了一種讀寫器的編解碼部分由FPGA來完成的設計方案，由FPGA負責前向鏈路的PIE編碼和后向鏈路的FM0／miller解碼，且解碼模塊可對標簽突發(fā)傳來的數(shù)據(jù)立即檢測并實施解碼，實現(xiàn)了較快的解碼速率。FPGA選用的是Altera公司的EP1C3T100C6芯片。
  • 本文對協(xié)議做了大體介紹，闡述了整個系統(tǒng)設計的硬件架構(gòu)，重點介紹了軟件設計中的數(shù)據(jù)基帶處理部分，對防碰撞部分、脈沖間隔編碼(PIE編碼)和雙向間隔解碼(FMO解碼)做了詳細介紹。