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DDS芯片
  • 為了測試電子設備的抗干擾能力，設計了一種射頻信號干擾器，可用于產(chǎn)生406 0～406.1 MHz范圍內的隨機干擾、點頻干擾和掃頻干擾信號。設計采用了直接數(shù)字頻率合成(DDS)技術，通過單片機對DDS芯片的控制，可靈活產(chǎn)生需要的干擾頻率。
  • 1971年，美國學者J.Tierney等人撰寫的“A Digital Frequency Synthesizer”-文首次提出了以全數(shù)字技術，從相位概念出發(fā)直接合成所需波形的一種新給成原理。限于當時的技術和器件產(chǎn)，它的性牟指標尚不能與已有的技術盯比，故未受到重視。